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[原创经验] w90x900驱动之二PLL值设定

[原创经验] w90x900驱动之二PLL值设定

int __init w90x900_setup_clocks(WB_PLL_T *sysClk)本站提供嵌入式底层驱动开发详尽的学习资料,技术帖子,面向嵌入式开发行业初学者,提供有针对性的技术培训服务。, D9 g- {  c  Q4 z
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(system clock:%dMHZ)\n",mhz);

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( Y5 F' v% `4 i+ u( H$ R" S, Hmcuos.comoutl(inl(W90X900_CLKSEL)|CPU_FROM_EXTAL15M,W90X900_CLKSEL);' V7 O% i6 f* d4 m

6 F4 V8 v  I' r/ Q( w3 s嵌入式, 嵌入式开发, Linux, arm, 驱动开发, 嵌入式学习//W90X900_CLKSEL是时钟源选择寄存器,我们在这里先要选择外部晶振15MHZ本站提供嵌入式底层驱动开发详尽的学习资料,技术帖子,面向嵌入式开发行业初学者,提供有针对性的技术培训服务。1 ^8 Y) @9 X: v1 L$ b" o
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//PLL0 output
,设置pll0的值
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outl(sysClk->pll1,W90X900_CLKPLL1);本站提供嵌入式底层驱动开发详尽的学习资料,技术帖子,面向嵌入式开发行业初学者,提供有针对性的技术培训服务。4 _4 K- p! D% S/ n7 }- F, ?
//PLL1 output
设置pll1的值
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, X* ^0 t! M2 ]本站提供嵌入式底层驱动开发详尽的学习资料,技术帖子,面向嵌入式开发行业初学者,提供有针对性的技术培训服务。// if sysClk->pll0==0x4124 then pll0 out==166MHZ本站提供嵌入式底层驱动开发详尽的学习资料,技术帖子,面向嵌入式开发行业初学者,提供有针对性的技术培训服务。6 _* B( |2 r  o
//设置寄存器CLKPLL0的值为:100000100100100==0x4124- 嵌入式底层驱动开发技术学习网站8 N% u, y  }- b
//fin=15MHZ晶振外部,no[56]==输出分频=1nf[715]==反馈分频=65nr==输入分频[04]=4
! j2 ?* D4 a4 U2 p嵌入式开发联盟Pll原理图:
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计算后的值:
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outl(inl(W90X900_CLKDIV)|(sysClk->ahb_clk<<24)|(sysClk->apb_clk<<26),W90X900_CLKDIV); //
W90X900_CLKDIV
分频寄存器

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if (sysClk->cpu_src == CPU_FROM_PLL0)

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else if (sysClk->cpu_src == CPU_FROM_PLL1)
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切回pll0作为cpu时钟源
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